도금 골드 포고 프로브

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구조의 물리적 특성이 다르기 때문에 다른 오류 모드가 표시됩니다. 그러나 대체로, 시험은 개별 트랜지스터에서 추상화됩니다, 그래서 난 당신이 큰 차이를 볼 거야 모르겠어요. 업계가 이러한 주요 아키텍처 변경 사항 중 하나를 거닐 때마다 일반적으로 테스트 강도가 급격한 증가합니다. 이 새로운 트랜지스터 구조와 관련된 오류 모드와 전체 물리적 아키텍처를 파악해야 합니다. 마이크로프로세서 공간에서 22nm또는 주조 공간의 14/16nm이든 첫 번째 finFET 노드에서 그 중 일부를 보았습니다.

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그 좋은 예는 프로브 카드의 전원 전달 및 / 또는 전원 임피던스 사양입니다. 테스트 계측에서 칩에 이 모든 전력을 전달하려는 경우, 그렇게 하는 경로는 훨씬 더 중요해지고 사양은 훨씬 더 단단해져야 합니다. 5년 전 프로브 카드의 전력 전달 성능은 그다지 큰 문제가 아니었습니다. 지금은 주요 디자인 고려 사항이며, 우리가 우세한 고객과 긴밀하게 협력하게되는 이유 중 하나입니다. 각 전원 공급 장치가 가질 수 있는 다른 허용 오차와 사양을 이해합니다. 일부는 조금 느슨하고, 일부는 매우 단단해야합니다. 각 디자인에 맞는 프로브 카드를 설계할 때 주요 성능 문제 중 하나가 됩니다.

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우리가하는 거의 모든 것은 맨손으로 죽거나 전체 웨이퍼이므로 패키지는 이 것의 다운스트림 조각으로 끝납니다. 그러나 패키지 설계에서 제약 조건이 되는 정전 전달과 관련된 동일한 많은 의미를 볼 수 있습니다. 역사적으로 포장 된 기판은 매우 간단한 구조였습니다 - 금속 층의 몇 층, 정말 엄격한 설계 요구 사항이 많지 않았습니다. 그게 바뀌었습니다. 이제 우리는 더 많은 레이어와 훨씬 더 복잡한 포장 기판을 보고 있다. 밀도를 통해 올라가고 있습니다. 전원 공급 장치 성능을 관리하고 조정해야 합니다. 이는 프로브 카드로 웨이퍼 수준에서 테스트하는 것뿐만 아니라 최종 패키지에서도 큰 문제가 되고 있습니다.

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이러한 각 구성 요소다이성이 기능적으로 양호하거나 최종 패키지에서 수리하기에 충분한지 확인하기 위해 테스트중입니다. 그리고 그들은 상당히 고급 노드에서 제작되고 있기 때문에 - 적어도 1x 또는 1y 나노 미터 DRAM 노드, 수율은 좋지 않다. 그래서 스택에 들어가는 다이가 얻을 수있는 만큼 좋은지 확인하는 간단한 기능적 특성입니다. 나는 완벽한 일의 개념을 전달하기 때문에 '알려진 좋은 다이'라는 용어를 사용하는 것을 꺼려하고, 반도체 산업에서 아무것도 완벽하지 않습니다. 비용의 균형과 사람들이 끊임없이 함께 플레이하는 위험의 균형이 있으며 DRAM에는 어느 정도의 수리 가능성과 중복성이 있습니다. 그래서 당신은 그 다른 손잡이의 모든 운동이되는 것을 볼 수 있습니다. 그러나 HBM은 DRAM 프로브 카드 비즈니스의 볼륨뿐만 아니라 사양 요구 사항에 도해 주었으며, 이를 계속 강화했습니다.

이러한 최신 장치 중 일부의 신뢰성 측면에 대 한, 사람들은 여전히 이것을 알아내고 있다. 그러나 온도 또는 진동 테스트를 통해 연소 및 가속 테스트와 유사한 것들이 있습니다. 그들은 현장에서 가장 가능성이 높은 실패 모드 또는 사람들이 우려하는 것들을 가속화하는 다양한 방법을 모색하고 있습니다. 여러 고객과 대화를 나눴지만, 이 시점에서 전기 및 광학 장치에 대한 전체 기능 테스트를 백업하는 것은 우리가 이 시점에 초점을 맞추고 있는 곳입니다.

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